include/dt-bindings/clock/r9a07g054-cpg.h

   1 /* SPDX-License-Identifier: (GPL-2.0-only OR BSD-2-Clause)
   2  *
   3  * Copyright (C) 2022 Renesas Electronics Corp.
   4  */
   5 #ifndef __DT_BINDINGS_CLOCK_R9A07G054_CPG_H__
   6 #define __DT_BINDINGS_CLOCK_R9A07G054_CPG_H__
   7
   8 #include <dt-bindings/clock/renesas-cpg-mssr.h>
   9
  10 /* R9A07G054 CPG Core Clocks */
  11 #define R9A07G054_CLK_I                 0
  12 #define R9A07G054_CLK_I2                1
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  37
  38 /* R9A07G054 Module Clocks */
  39 #define R9A07G054_CA55_SCLK             0
  40 #define R9A07G054_CA55_PCLK             1
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 141
 142 /* R9A07G054 Resets */
 143 #define R9A07G054_CA55_RST_1_0          0
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 187 #define R9A07G054_CRU_PRESETN           44
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 190 #define R9A07G054_MIPI_DSI_ARESET_N     47
 191 #define R9A07G054_MIPI_DSI_PRESET_N     48
 192 #define R9A07G054_LCDC_RESET_N          49
 193 #define R9A07G054_SSI0_RST_M2_REG       50
 194 #define R9A07G054_SSI1_RST_M2_REG       51
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 196 #define R9A07G054_SSI3_RST_M2_REG       53
 197 #define R9A07G054_SRC_RST               54
 198 #define R9A07G054_USB_U2H0_HRESETN      55
 199 #define R9A07G054_USB_U2H1_HRESETN      56
 200 #define R9A07G054_USB_U2P_EXL_SYSRST    57
 201 #define R9A07G054_USB_PRESETN           58
 202 #define R9A07G054_ETH0_RST_HW_N         59
 203 #define R9A07G054_ETH1_RST_HW_N         60
 204 #define R9A07G054_I2C0_MRST             61
 205 #define R9A07G054_I2C1_MRST             62
 206 #define R9A07G054_I2C2_MRST             63
 207 #define R9A07G054_I2C3_MRST             64
 208 #define R9A07G054_SCIF0_RST_SYSTEM_N    65
 209 #define R9A07G054_SCIF1_RST_SYSTEM_N    66
 210 #define R9A07G054_SCIF2_RST_SYSTEM_N    67
 211 #define R9A07G054_SCIF3_RST_SYSTEM_N    68
 212 #define R9A07G054_SCIF4_RST_SYSTEM_N    69
 213 #define R9A07G054_SCI0_RST              70
 214 #define R9A07G054_SCI1_RST              71
 215 #define R9A07G054_IRDA_RST              72
 216 #define R9A07G054_RSPI0_RST             73
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 218 #define R9A07G054_RSPI2_RST             75
 219 #define R9A07G054_CANFD_RSTP_N          76
 220 #define R9A07G054_CANFD_RSTC_N          77
 221 #define R9A07G054_GPIO_RSTN             78
 222 #define R9A07G054_GPIO_PORT_RESETN      79
 223 #define R9A07G054_GPIO_SPARE_RESETN     80
 224 #define R9A07G054_ADC_PRESETN           81
 225 #define R9A07G054_ADC_ADRST_N           82
 226 #define R9A07G054_TSU_PRESETN           83
 227 #define R9A07G054_STPAI_ARESETN         84
 228
 229 #endif /* __DT_BINDINGS_CLOCK_R9A07G054_CPG_H__ */